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示意模型，非 EVA100 实机
关键数字
- 内存 · 每工位
- 4GB DDR带宽 25.6 G/s（资料口径）
- 图像接口
- 1.5Gbps每 lane · MIPI CSI-2 D-PHY
- 算力 · 每工位
- 400GFLOPS4 核 ARM + 128 GPU 核
- 演示处理时间
- 约 100ms3264 × 2464 · 8 帧
算力放到工位上
图像传感器测试的瓶颈在图像数据：帧一大、工位一多，回传工作站处理就占掉节拍。这个方案在 EVA100 平台上逐工位配图像板，算法在本地执行，工位之间互不等待。
用在哪里
多工位并行 CIS 测试
逐工位独立处理图像数据，避免集中回传的通信开销，尤其适合 trim 类操作。
图像接口采集
MIPI CSI-2 D-PHY 1/2/4 data lane 采图；DVP 10/12 bit 与 LVDS 为可扩展项，覆盖 RGB、YUV、RAW 格式族。
算法本地执行
演示条件下，3264 × 2464、8 帧图像的算法处理约 100 ms。
按项目定义
测试项目清单、判定方法与交付形态按具体工程确定。
立项后的推进（示意）
- 器件与接口确认确定传感器输出接口、图像格式、工位数与目标节拍。
- APU 与光源配置按工位数配置图像板、受控光源与 EVA100 资源。
- 算法与序列开发图像处理算法部署在 APU，测试序列运行在 EVA100。
- 方案验证以演示与样品验证节拍与数据通路，再定义交付形态。
规格
具体配置根据器件接口、图像格式、工位数与工程条件确定。
完整规格表（9 项）
| 项目 | 规格 / 配置 | 说明 |
|---|---|---|
| 系统架构 | EVA100 测试机 + 逐工位 Image Board（APU）+ 受控光源 | Ethernet 连接测试机与图像板 |
| APU 构成 | AI 多核处理器 + FPGA 灵活逻辑 | 每工位 4 核 ARM 64 bit + 128 GPU 核，可升级 256 / 512 核 |
| 算力 | 400 GFLOPS，可升级至 20 TFLOPS | 核心为来自大型 fabless 的成熟 AI SoC |
| 内存 | 每工位 4 GB DDR，带宽 25.6 G/s（资料口径） | 可升级 8 GB / 51.2 G/s |
| 图像接口 | MIPI CSI-2 D-PHY：1/2/4 data lane + 1 clock lane，至 1.5 Gbps/lane | 可升级 2.5 Gbps/lane；DVP 10/12 bit 与 LVDS 为资料所载可扩展项 |
| 图像格式 | RGB888 / RGB666 / RGB565；YUV422-8b / YUV444-8b；RAW6 / 7 / 8 / 10 / 12 / 14 | 按器件输出格式配置 |
| 软件栈 | EVA 测试序列 / 图像处理 API / 光源 API / APU 驱动 | 运行于 EVA100 系统软件之上 |
| 演示结果 | 3264 × 2464，8 帧，算法运行约 100 ms | 培训资料所载 demo 条件 |
| 路线方向 | D-PHY 向 2.5 Gbps/lane、C-PHY 向 2.5 Gsym/s per trio 演进 | 资料所载路线节点为 2021 年，现状以工程确认为准 |
内容出自 2022 年 EVA100 培训资料的 CMOS 图像传感器方案章节（系统架构、APU 规格与演示数据），交付形态按具体项目定义。未列出的指标以技术协议为准。
方案基于 Advantest EVA100 平台。EVA100 是 Advantest 的产品，名称只用于界定方案的适用平台，不代表获得原厂授权、认证或背书。图像处理板（APU）的工程主体资料未写明，本页不作自研主张。
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把器件接口、图像格式和目标交给工程团队
提交样品、现有设备、当前问题和目标节拍，我们将在 1 个工作日内确认收到。